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题名/责任者:

基于Verilog HDL与Cadence的数字系统设计技术/解本巨编著

出版发行项:

北京:清华大学出版社,2013

ISBN及定价:

978-7-302-31470-7/CNY29.50

载体形态项:

vi, 262页:图;26cm

个人责任者:

解本巨 编著

学科主题:

数字电路-计算机辅助设计-VHDL语言

学科主题:

印刷电路-电路设计-计算机辅助设计

中图法分类号:

TN790.2

书目附注:

有书目

提要文摘附注:

本书是以EDA技术设计为出发点，专门针对各大高校信息、自动化、计算机专业在校学生和在公司中初始学习硬件技术的开发人员而编写的数字系统制版技术材料，主要目的是使读者克服学习硬件开发技术的困难，使学习硬件技术像学习软件技术一样简单。本书的技术开发以逻辑代数的运算、定理和化简方法为理论指导，研究原理图设计方法，引入FPGA的开发软件QuartusⅡ9.1，在其中利用Verilog HDL设计实现电路常用芯片的开发，可以在不必了解芯片内部工作原理的基础，通过程序设计者的硬件行为描述获得芯片及引脚的相关信息。

使用对象附注:

本书可以作为嵌入式数字系统开发的基础技术设计指导书，是硬件制版技术快速入门的绝佳教材，为更多的硬件技术设计爱好者提供了广阔的空间。

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