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题名/责任者:

Verilog HDL数字设计与建模/(美) Joseph Cavanagh著 陈亦欧, 李林, 黄乐天译

出版发行项:

北京:电子工业出版社,2011

ISBN及定价:

978-7-121-14093-8/CNY69.00

载体形态项:

15, 579页:图;26cm

统一题名:

Verilog HDL digital design and modeling

丛编项:

国外电子与通信教材系列

个人责任者:

卡瓦纳 (Cavanagh, Joseph) 著

个人次要责任者:

陈亦欧 译

个人次要责任者:

李林 译

个人次要责任者:

黄乐天 译

学科主题:

VHDL语言-程序设计-高等学校-教材

中图法分类号:

TP312VH

出版发行附注:

由Taylor & Francis Group, LLC授权出版

提要文摘附注:

本书内容涵盖了电路建模、基本语法与电路、典型数学运算、复杂的编码/解码/纠错电路、各类时序状态机和完整的流水线RISC处理器的设计等。

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