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题名/责任者:

面向CPLD/FPGA的Verilog设计/王冠，俞一鸣等编著

出版发行项:

北京:机械工业出版社,2007

ISBN及定价:

978-7-111-21057-3/CNY40.00

载体形态项:

372页:图;26cm

丛编项:

可编程逻辑器件实用开发技术丛书

个人责任者:

王冠 编著

个人责任者:

俞一鸣 编著

学科主题:

可编程序逻辑器件-程序设计

学科主题:

硬件描述语言-程序设计

非控制主题词:

CPLD FPGA Verilog

中图法分类号:

TP332.1

书目附注:

有书目

提要文摘附注:

本书翔实地介绍了面向CPLD/FPGA的Verilog设计。全书分为器件篇、语言篇、软件篇和实战篇来介绍相应的知识体系。器件篇着重介绍了Altera公司的CYCLONE Ⅱ系列FPGA的结构，以及如何使用FPGA器件内部的各种资源；语言篇详细讲解了Verilog HDI的相关内容；软件篇介绍了一款强大的仿真工具ModelSim和Altera公司的集成开发环境Quartus Ⅱ6.0；实战篇再现了一个数字系统的设计过程。

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