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题名/责任者:

Verilog HDL实用教程/王金明, 徐程骥编著

出版发行项:

北京:电子工业出版社,2023

ISBN及定价:

978-7-121-44867-6/CNY69.00

载体形态项:

XI, 296页:图;26cm

丛编项:

普通高等教育EDA技术教材

个人责任者:

王金明 编著

个人责任者:

徐程骥 编著

学科主题:

VHDL语言-程序设计-高等学校-教材

中图法分类号:

TP312

书目附注:

有书目

提要文摘附注:

本书系统讲解VerilogHDL语言规则、语法体系, 以Verilog-2001和Verilog-2005两种语言标准为依据, 精讲语言, 全面梳理, 知识点系统全面。本书立足语言本身, 按照语言体系编排内容, 涵盖所有常用语法规则, 补充Verilog-2005中新的语言点, 既适合作为必备语法资料查询, 也适合有一定设计基础的读者学习。主要内容包括VerilogHDL入门、数据类型、表达式、门级和开关级建模、数据流建模、行为级建模、层次结构、任务与函数、TestBench测试与时序检查、面向综合的设计、有限状态机设计、VerilogHDL设计实例等, 重点聚焦VerilogHDL综合和仿真, 对语言、语法规则用案例进行阐释, 用综合工具和仿真工具进行验证, 利于读者加深理解。

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